基于FPGA千兆以太网的开发：以太网接口中的术语解释

在开发以太网接口的过程中，我们经常看到英文缩写，例如MII，RMII，GMII和RGMII。在开发界面之前，请先弄清楚这些术语。
1 MIIMII（MediumIndependentInterface）的缩写，翻译成中文是“ Medium Independent Interface”。该接口通常用于以太网硬件平台的MAC层和PHY层之间。
MII接口类型很多，常用的有MII，RMII，SMII，SSMII，SSSMII，GMII，RGMII，SGMII，TBI，RTBI，XGMII，XAUI，XLAUI等。MII支持10M和100M操作。
一个接口由14条线组成。它的支持仍然相对灵活，但是有一个缺点，因为它为一个端口使用了太多的信号线。
RXD（ReceiveData）[3：0]：数据接收信号，共4条信号线； TX_ER（TransmitError）：发送数据错误警告信号，与TX_CLK同步，为高电平有效，表示在TX_ER有效期内发送的数据无效。对于10Mbps速率，TX_ER不起作用；否则，TX_ER不起作用。
RX_ER（ReceiveError）：接收数据错误警告信号，与RX_CLK同步，为高电平有效，指示在RX_ER的有效期间内发送的数据无效。对于10Mbps速率，RX_ER不起作用； TX_EN（TransmitEnable）：发送使能信号，仅在TX_EN有效期内发送的数据有效； RX_DV（ReveiveDataValid）：接收数据有效信号，功能类型为发送通道的TX_EN； TX_CLK：发送参考时钟，速率为100Mbps，时钟频率为25MHz，速率为10Mbps，时钟频率为2.5MHz。
请注意，TX_CLK时钟的方向是从PHY端到MAC端，因此此时钟由PHY提供。 RX_CLK：接收数据的参考时钟，速率为100Mbps，时钟频率为25MHz，速率为10Mbps，时钟频率为2.5MHz。
PHY端也提供了RX_CLK。 CRS：CarrierSense，载波检测信号，不需要与参考时钟同步，只要有数据传输，CRS就有效。
另外，CRS仅在半双工模式下的PHY中有效。 COL：CollisionDetectd，冲突检测信号，不需要与参考时钟同步，仅PHY在半双工模式下有效。
MII接口共有16条线路。 2RMIIRMII是简化的MII接口。
在数据发送和接收中，它的信号线数量是MII接口的两倍，因此通常需要50M的总线时钟，这是MII接口时钟的两倍。与MII接口相比，GMII的数据宽度从4位变为8位。
GMII接口中的控制信号，例如TX_ER，TX_EN，RX_ER，RX_DV，CRS和COL具有与MII接口中相同的功能，发送参考时钟GTX_CLK接收参考时钟RX_CLK的频率为125MHz（1000Mbps） / 8 = 125MHz）。这里有一点需要特别说明，即发送参考时钟GTX_CLK，它与MII接口中的TX_CLK不同。
MII接口中的TX_CLK由PHY芯片提供给MAC芯片，而GMII接口中的GTX_CLK由PHY芯片提供。 MAC芯片被提供给PHY芯片。
这两个方向是不同的。在实际应用中，大多数GMII接口与MII接口兼容。
因此，通用GMII接口具有两个发送参考时钟：TX_CLK和GTX_CLK（如上所述，两个方向是不同的）在MII模式下使用时，请使用TX_CLK和8条数据线中的4条。 GMII是千兆以太网的MII接口。
GMII使用8位接口数据，工作时钟为125MHz，因此传输速率可以达到1000Mbps。同时，它与MII指定的10 / 100Mbps工作模式兼容。
4RGMIIRGMII接口代表简化的GMII接口。 RGMII使用工作时钟为125MHz的4位数据接口，并同时在上升沿和下降沿传输数据，因此传输速率可以达到1000Mbps。
同时，它与MII指定的10 / 100Mbps工作模式兼容，并支持传输速率：10M / 100M / 1000Mb / s，对应的clk信号为：2.5MHz / 25MHz / 125MHz。

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